채용 중 직무

• HW(IP) 개발 프로젝트 리딩 및 아키텍처 설계 (IP 스펙 정의, 아키텍처 설계, RTL 코딩 및 시뮬레이션/합성을 포함한 고성능 하드웨어 IP 개발 총괄)

• • Technical leader 역할 수행 (팀 내 엔지니어들의 기술적 역량 향상을 가이드하고, 설계 및 검증 과정의 병목 현상을 해결하는 기술 중심의 리더십 수행)
• • 타 개발 부서와 협업

• 고객사 기술 대응 (Pre/Post-Sales Support)

• Verilog RTL 기반의 HW 설계 경력 (시니어/리더급 역량 보유자)

• • 반도체 IP 및 HW 개발 전 과정(Front-end 전반)에 대한 깊은 이해와 실무 경험
• • 프로젝트 리딩(Project Management) 및 개발 인력 매니지먼트/코칭 경험

• 논리적이고 원활한 커뮤니케이션 능력을 바탕으로 팀을 리드하고 타 부서와 조율할 수 있는 분

• 글로벌 비즈니스 커뮤니케이션 가능자 (영어 회화 및 기술 문서 작성)

• • SoC Chip 개발 및 양산(Tape-out) 경험자
• • RTL 설계 외에 시스템 소프트웨어 및 펌웨어에 대한 이해도가 높은 분

• 비디오 코덱(H.264, HEVC, AV1 등) 또는 이미지 처리 알고리즘 하드웨어 가속기 설계 경험자

• 유연근무 (Core time 운영 11:30 ~ 15:30)

• 점심/저녁 지원

• 선택적복리후생비 연 300만원 제공

• Refresh 휴가 및 휴가비 지원

• 연 70만원 상당 건강검진 제공

• 사내 세미나 활성화 등 개발 역량 향상을 위한 지원

• 영어 닉네임 사용

• 학사 신입기준 연봉 5000만원

• 채용 프로세스 : 서류 > RTL TEST > 인터뷰 > 최종 합격 (*상황에 따라 RTL TEST는 생략될 수 있습니다)

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• 이력서 내용이 사실과 다를 경우 채용이 취소될 수 있습니다.